EDA技术与应用
EDA技术与应用
少于1000 人选课
更新日期:2025/05/22
开课平台智慧树
开课高校山东科技大学
开课教师张德学张小军王维克卫阿盈
学科专业工学电子信息类
开课时间2025/01/21 - 2025/07/20
课程周期26 周
开课状态开课中
每周学时-
课程简介
《EDA技术与应用》是电科专业基础必修课,EDA技术是现代电子设计技术的核心,本课程旨在使得学生掌握利用软件设计开发硬件电路的基本技能,为从事相关工作打下良好基础。
课程大纲

在线教程

章节简介教学计划
课程概述
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课程概述
张德学
Verilog HDL介绍
HDL发展历史简介
张小军
基于HDL的现代数字电路设计流程
张小军
Verilog HDL 基本语法介绍
Verilog模块
张小军
Verilog 标识符、关键词与注释
张小军
四值逻辑 与数据表示
张小军
端口类型
张小军
算术运算
张小军
位运算与规约运算
张小军
逻辑运算
张小军
比较运算
张小军
拼接和重复运算
张小军
移位与条件操作
张小军
always
张小军
if-else 与 case 语句
张小军
循环语句
张小军
阻塞赋值与非阻塞赋值
张小军
ModelSim使用
ModelSim介绍
张德学
ModelSim使用
张德学
PLD器件介绍
可编程器件的概述
卫阿盈
PLD的分类
PLD的分类(上)
卫阿盈
PLD的分类(下)
卫阿盈
PLD的基本结构
卫阿盈
CPLD的基本结构与特点
卫阿盈
FPGA的基本结构与特点
卫阿盈
CPLD与FPGA的比较
卫阿盈
FPGA开发流程简介与QuartusII工具使用
FPGA开发流程简介
张德学
QuartusII软件及其使用
卫阿盈
IP核
卫阿盈
时序逻辑描述与实现
由基本门构建时序逻辑
张德学
数字电路基本部件描述举例
张德学
TestBench设计
TestBench结构
王维克
系统任务
王维克
电路激励生成方法
王维克
函数与任务
王维克
VCD输出
王维克
参数的用法
王维克
实例演示
王维克
有限状态机及其描述方法
有限状态机与状态转移图
王维克
有限状态机编码风格
王维克
状态编码
王维克
电路评价与编码风格
概述
张德学
编码风格
避免生成多余的Latch
张德学
仿真与综合结果不一致
张德学
优先级编码
张德学
资源共享
张德学
其他常见问题
张德学
  • 第一章课程概述

    EDA技术与应用课程概述

  • 1.1课程概述

    EDA技术与应用课程概述

  • 第二章Verilog HDL介绍

    本章主要介绍Verilog 的基本语法

  • 2.1HDL发展历史简介

    简要介绍HDL的发展历史

  • 2.2基于HDL的现代数字电路设计流程

    介绍基于HDL的现代数字电路设计流程

  • 2.3Verilog HDL 基本语法介绍

    本节主要介绍Verilog的基本语法

  • 第三章ModelSim使用

    ModelSim使用

  • 3.1ModelSim介绍

    介绍ModelSim

  • 3.2ModelSim使用

    演示ModelSim使用

  • 第四章PLD器件介绍

    PLD器件介绍

  • 4.1可编程器件的概述

    讲述PLD器件的发展历史

  • 4.2PLD的分类

    根据不同的分类方式对PLD器件进行分类

  • 4.3PLD的基本结构

    讲述PLD器件的基本结构

  • 4.4CPLD的基本结构与特点

    讲述CPLD的基本结构与特点

  • 4.5FPGA的基本结构与特点

    讲述FPGA的基本结构与特点

  • 4.6CPLD与FPGA的比较

    对CPLD与FPGA进行比较,对两者的应该进行选择

  • 第五章FPGA开发流程简介与QuartusII工具使用

    FPGA开发流程简介与QuartusII工具使用

  • 5.1FPGA开发流程简介

    FPGA开发流程简介

  • 5.2QuartusII软件及其使用

    讲述QuartusII的编辑环境,并且举例讲解软件的使用情况

  • 5.3IP核

    IP核

  • 第六章时序逻辑描述与实现

    时序逻辑描述与实现

  • 6.1由基本门构建时序逻辑

    由基本门构建时序逻辑

  • 6.2数字电路基本部件描述举例

    数字电路基本部件描述举例

  • 第七章TestBench设计

    TestBench结构与设计方法

  • 7.1TestBench结构

    TestBench简介及其基本结构

  • 7.2系统任务

    TestBench设计中常用的系统任务

  • 7.3电路激励生成方法

    TestBench设计中对时钟信号、复位信号和一般输入信号的生成方法

  • 7.4函数与任务

    函数、任务的用法与异同

  • 7.5VCD输出

    使用dump系统任务调用到处VCD文件,并与wlf、fsdb格式进行转换

  • 7.6参数的用法

    参数parameter的用法

  • 7.7实例演示

    简单测试,自测试,带向量文件的自测试实例

  • 第八章有限状态机及其描述方法

    有限状态机及其HDL描述方法

  • 8.1有限状态机与状态转移图

    介绍有限状态机定义,应用,分类和状态转移图

  • 8.2有限状态机编码风格

    FSM的两段、三段式描述方法及其特点

  • 8.3状态编码

    二进制码,独热码,格雷码编码及其区别

  • 第九章电路评价与编码风格

    电路评价与编码风格

  • 9.1概述

    概述

  • 9.2编码风格

    编码风格

  • 开始学习
  • 第一章  作业测试
    第一章 课程概述

    1.1 课程概述

    视频数1
  • 第二章  作业测试
    第二章 Verilog HDL介绍

    2.1 HDL发展历史简介

    2.2 基于HDL的现代数字电路设计流程

    2.3 Verilog HDL 基本语法介绍

    视频数16
  • 第三章  作业测试
    第三章 ModelSim使用

    3.1 ModelSim介绍

    3.2 ModelSim使用

    视频数2
  • 第四章  作业测试
    第四章 PLD器件介绍

    4.1 可编程器件的概述

    4.2 PLD的分类

    4.3 PLD的基本结构

    4.4 CPLD的基本结构与特点

    4.5 FPGA的基本结构与特点

    4.6 CPLD与FPGA的比较

    视频数7
  • 第五章  作业测试
    第五章 FPGA开发流程简介与QuartusII工具使用

    5.1 FPGA开发流程简介

    5.2 QuartusII软件及其使用

    5.3 IP核

    视频数3
  • 第六章  作业测试
    第六章 时序逻辑描述与实现

    6.1 由基本门构建时序逻辑

    6.2 数字电路基本部件描述举例

    视频数2
  • 第七章  作业测试
    第七章 TestBench设计

    7.1 TestBench结构

    7.2 系统任务

    7.3 电路激励生成方法

    7.4 函数与任务

    7.5 VCD输出

    7.6 参数的用法

    7.7 实例演示

    视频数7
  • 第八章  作业测试
    第八章 有限状态机及其描述方法

    8.1 有限状态机与状态转移图

    8.2 有限状态机编码风格

    8.3 状态编码

    视频数3
  • 第九章  作业测试
    第九章 电路评价与编码风格

    9.1 概述

    9.2 编码风格

    视频数6
  • 期末考试